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Oded Gabbay 1177 100.00% 1 100.00%
Total 1177 1 


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#ifndef __GAUDI_ASYNC_EVENTS_H_
#define __GAUDI_ASYNC_EVENTS_H_

enum gaudi_async_event_id {
	GAUDI_EVENT_PCIE_CORE_SERR = 32,
	GAUDI_EVENT_PCIE_CORE_DERR = 33,
	GAUDI_EVENT_PCIE_IF_SERR = 34,
	GAUDI_EVENT_PCIE_IF_DERR = 35,
	GAUDI_EVENT_PCIE_PHY_SERR = 36,
	GAUDI_EVENT_PCIE_PHY_DERR = 37,
	GAUDI_EVENT_TPC0_SERR = 38,
	GAUDI_EVENT_TPC1_SERR = 39,
	GAUDI_EVENT_TPC2_SERR = 40,
	GAUDI_EVENT_TPC3_SERR = 41,
	GAUDI_EVENT_TPC4_SERR = 42,
	GAUDI_EVENT_TPC5_SERR = 43,
	GAUDI_EVENT_TPC6_SERR = 44,
	GAUDI_EVENT_TPC7_SERR = 45,
	GAUDI_EVENT_TPC0_DERR = 46,
	GAUDI_EVENT_TPC1_DERR = 47,
	GAUDI_EVENT_TPC2_DERR = 48,
	GAUDI_EVENT_TPC3_DERR = 49,
	GAUDI_EVENT_TPC4_DERR = 50,
	GAUDI_EVENT_TPC5_DERR = 51,
	GAUDI_EVENT_TPC6_DERR = 52,
	GAUDI_EVENT_TPC7_DERR = 53,
	GAUDI_EVENT_MME0_ACC_SERR = 54,
	GAUDI_EVENT_MME0_ACC_DERR = 55,
	GAUDI_EVENT_MME0_SBAB_SERR = 56,
	GAUDI_EVENT_MME0_SBAB_DERR = 57,
	GAUDI_EVENT_MME1_ACC_SERR = 58,
	GAUDI_EVENT_MME1_ACC_DERR = 59,
	GAUDI_EVENT_MME1_SBAB_SERR = 60,
	GAUDI_EVENT_MME1_SBAB_DERR = 61,
	GAUDI_EVENT_MME2_ACC_SERR = 62,
	GAUDI_EVENT_MME2_ACC_DERR = 63,
	GAUDI_EVENT_MME2_SBAB_SERR = 64,
	GAUDI_EVENT_MME2_SBAB_DERR = 65,
	GAUDI_EVENT_MME3_ACC_SERR = 66,
	GAUDI_EVENT_MME3_ACC_DERR = 67,
	GAUDI_EVENT_MME3_SBAB_SERR = 68,
	GAUDI_EVENT_MME3_SBAB_DERR = 69,
	GAUDI_EVENT_DMA0_SERR_ECC = 70,
	GAUDI_EVENT_DMA1_SERR_ECC = 71,
	GAUDI_EVENT_DMA2_SERR_ECC = 72,
	GAUDI_EVENT_DMA3_SERR_ECC = 73,
	GAUDI_EVENT_DMA4_SERR_ECC = 74,
	GAUDI_EVENT_DMA5_SERR_ECC = 75,
	GAUDI_EVENT_DMA6_SERR_ECC = 76,
	GAUDI_EVENT_DMA7_SERR_ECC = 77,
	GAUDI_EVENT_DMA0_DERR_ECC = 78,
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	GAUDI_EVENT_DMA2_DERR_ECC = 80,
	GAUDI_EVENT_DMA3_DERR_ECC = 81,
	GAUDI_EVENT_DMA4_DERR_ECC = 82,
	GAUDI_EVENT_DMA5_DERR_ECC = 83,
	GAUDI_EVENT_DMA6_DERR_ECC = 84,
	GAUDI_EVENT_DMA7_DERR_ECC = 85,
	GAUDI_EVENT_CPU_IF_ECC_SERR = 86,
	GAUDI_EVENT_CPU_IF_ECC_DERR = 87,
	GAUDI_EVENT_PSOC_MEM_SERR = 88,
	GAUDI_EVENT_PSOC_CORESIGHT_SERR = 89,
	GAUDI_EVENT_PSOC_MEM_DERR = 90,
	GAUDI_EVENT_PSOC_CORESIGHT_DERR = 91,
	GAUDI_EVENT_SRAM0_SERR = 92,
	GAUDI_EVENT_SRAM1_SERR = 93,
	GAUDI_EVENT_SRAM2_SERR = 94,
	GAUDI_EVENT_SRAM3_SERR = 95,
	GAUDI_EVENT_SRAM7_SERR = 96,
	GAUDI_EVENT_SRAM6_SERR = 97,
	GAUDI_EVENT_SRAM5_SERR = 98,
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	GAUDI_EVENT_SRAM8_SERR = 100,
	GAUDI_EVENT_SRAM9_SERR = 101,
	GAUDI_EVENT_SRAM10_SERR = 102,
	GAUDI_EVENT_SRAM11_SERR = 103,
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	GAUDI_EVENT_NIC2_DERR = 168,
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	GAUDI_EVENT_NIC4_DERR = 170,
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	GAUDI_EVENT_DMA_IF2_DERR = 182,
	GAUDI_EVENT_DMA_IF3_DERR = 183,
	GAUDI_EVENT_GIC500 = 184,
	GAUDI_EVENT_HBM_0_SERR = 185,
	GAUDI_EVENT_HBM_1_SERR = 186,
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	GAUDI_EVENT_HBM_0_DERR = 189,
	GAUDI_EVENT_HBM_1_DERR = 190,
	GAUDI_EVENT_HBM_2_DERR = 191,
	GAUDI_EVENT_HBM_3_DERR = 192,
	GAUDI_EVENT_MMU_SERR = 193,
	GAUDI_EVENT_MMU_DERR = 194,
	GAUDI_EVENT_PCIE_DEC = 200,
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	GAUDI_EVENT_PSOC_PRSTN_FALL = 263,
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	GAUDI_EVENT_TPC2_KRN_ERR = 313,
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	GAUDI_EVENT_TPC4_BMON_SPMU = 324,
	GAUDI_EVENT_TPC4_KRN_ERR = 325,
	GAUDI_EVENT_TPC5_BMON_SPMU = 330,
	GAUDI_EVENT_TPC5_KRN_ERR = 331,
	GAUDI_EVENT_TPC6_BMON_SPMU = 336,
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	GAUDI_EVENT_TPC7_BMON_SPMU = 342,
	GAUDI_EVENT_TPC7_KRN_ERR = 343,
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	GAUDI_EVENT_DMA_BM_CH0 = 383,
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	GAUDI_EVENT_DMA_BM_CH3 = 386,
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	GAUDI_EVENT_DMA_BM_CH5 = 388,
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	GAUDI_EVENT_PI_UPDATE = 484,
	GAUDI_EVENT_HALT_MACHINE = 485,
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	GAUDI_EVENT_SOFT_RESET = 487,
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	GAUDI_EVENT_FIX_THERMAL_ENV_S = 660,
	GAUDI_EVENT_FIX_THERMAL_ENV_E = 661,
	GAUDI_EVENT_RAZWI_OR_ADC_SW = 662,
	GAUDI_EVENT_SIZE,
};

#endif /* __GAUDI_ASYNC_EVENTS_H_ */