| Author | Tokens | Token Proportion | Commits | Commit Proportion |
|---|---|---|---|---|
| Rajendra Nayak | 1897 | 100.00% | 1 | 100.00% |
| Total | 1897 | 1 |
/* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */ /* * Copyright (c) 2023, Qualcomm Innovation Center, Inc. All rights reserved. */ #ifndef _DT_BINDINGS_CLK_QCOM_GCC_X1E80100_H #define _DT_BINDINGS_CLK_QCOM_GCC_X1E80100_H /* GCC clocks */ #define GCC_AGGRE_NOC_USB_NORTH_AXI_CLK 0 #define GCC_AGGRE_NOC_USB_SOUTH_AXI_CLK 1 #define GCC_AGGRE_UFS_PHY_AXI_CLK 2 #define GCC_AGGRE_USB2_PRIM_AXI_CLK 3 #define GCC_AGGRE_USB3_MP_AXI_CLK 4 #define GCC_AGGRE_USB3_PRIM_AXI_CLK 5 #define GCC_AGGRE_USB3_SEC_AXI_CLK 6 #define GCC_AGGRE_USB3_TERT_AXI_CLK 7 #define GCC_AGGRE_USB4_0_AXI_CLK 8 #define GCC_AGGRE_USB4_1_AXI_CLK 9 #define GCC_AGGRE_USB4_2_AXI_CLK 10 #define GCC_AGGRE_USB_NOC_AXI_CLK 11 #define GCC_AV1E_AHB_CLK 12 #define GCC_AV1E_AXI_CLK 13 #define GCC_AV1E_XO_CLK 14 #define GCC_BOOT_ROM_AHB_CLK 15 #define GCC_CAMERA_AHB_CLK 16 #define GCC_CAMERA_HF_AXI_CLK 17 #define GCC_CAMERA_SF_AXI_CLK 18 #define GCC_CAMERA_XO_CLK 19 #define GCC_CFG_NOC_PCIE_ANOC_AHB_CLK 20 #define GCC_CFG_NOC_PCIE_ANOC_NORTH_AHB_CLK 21 #define GCC_CFG_NOC_PCIE_ANOC_SOUTH_AHB_CLK 22 #define GCC_CFG_NOC_USB2_PRIM_AXI_CLK 23 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GCC_USB_1_PHY_GDSC 25 #define GCC_USB_2_PHY_GDSC 26 /* GCC resets */ #define GCC_AV1E_BCR 0 #define GCC_CAMERA_BCR 1 #define GCC_DISPLAY_BCR 2 #define GCC_GPU_BCR 3 #define GCC_PCIE_0_LINK_DOWN_BCR 4 #define GCC_PCIE_0_NOCSR_COM_PHY_BCR 5 #define GCC_PCIE_0_PHY_BCR 6 #define GCC_PCIE_0_PHY_NOCSR_COM_PHY_BCR 7 #define GCC_PCIE_0_TUNNEL_BCR 8 #define GCC_PCIE_1_LINK_DOWN_BCR 9 #define GCC_PCIE_1_NOCSR_COM_PHY_BCR 10 #define GCC_PCIE_1_PHY_BCR 11 #define GCC_PCIE_1_PHY_NOCSR_COM_PHY_BCR 12 #define GCC_PCIE_1_TUNNEL_BCR 13 #define GCC_PCIE_2_LINK_DOWN_BCR 14 #define GCC_PCIE_2_NOCSR_COM_PHY_BCR 15 #define GCC_PCIE_2_PHY_BCR 16 #define GCC_PCIE_2_PHY_NOCSR_COM_PHY_BCR 17 #define GCC_PCIE_2_TUNNEL_BCR 18 #define GCC_PCIE_3_BCR 19 #define GCC_PCIE_3_LINK_DOWN_BCR 20 #define GCC_PCIE_3_NOCSR_COM_PHY_BCR 21 #define GCC_PCIE_3_PHY_BCR 22 #define GCC_PCIE_3_PHY_NOCSR_COM_PHY_BCR 23 #define GCC_PCIE_4_BCR 24 #define GCC_PCIE_4_LINK_DOWN_BCR 25 #define GCC_PCIE_4_NOCSR_COM_PHY_BCR 26 #define GCC_PCIE_4_PHY_BCR 27 #define GCC_PCIE_4_PHY_NOCSR_COM_PHY_BCR 28 #define GCC_PCIE_5_BCR 29 #define GCC_PCIE_5_LINK_DOWN_BCR 30 #define GCC_PCIE_5_NOCSR_COM_PHY_BCR 31 #define GCC_PCIE_5_PHY_BCR 32 #define GCC_PCIE_5_PHY_NOCSR_COM_PHY_BCR 33 #define GCC_PCIE_6A_BCR 34 #define GCC_PCIE_6A_LINK_DOWN_BCR 35 #define GCC_PCIE_6A_NOCSR_COM_PHY_BCR 36 #define GCC_PCIE_6A_PHY_BCR 37 #define GCC_PCIE_6A_PHY_NOCSR_COM_PHY_BCR 38 #define GCC_PCIE_6B_BCR 39 #define GCC_PCIE_6B_LINK_DOWN_BCR 40 #define GCC_PCIE_6B_NOCSR_COM_PHY_BCR 41 #define GCC_PCIE_6B_PHY_BCR 42 #define GCC_PCIE_6B_PHY_NOCSR_COM_PHY_BCR 43 #define GCC_PCIE_PHY_BCR 44 #define GCC_PCIE_PHY_CFG_AHB_BCR 45 #define GCC_PCIE_PHY_COM_BCR 46 #define GCC_PCIE_RSCC_BCR 47 #define GCC_PDM_BCR 48 #define GCC_QUPV3_WRAPPER_0_BCR 49 #define GCC_QUPV3_WRAPPER_1_BCR 50 #define GCC_QUPV3_WRAPPER_2_BCR 51 #define GCC_QUSB2PHY_HS0_MP_BCR 52 #define GCC_QUSB2PHY_HS1_MP_BCR 53 #define GCC_QUSB2PHY_PRIM_BCR 54 #define GCC_QUSB2PHY_SEC_BCR 55 #define GCC_QUSB2PHY_TERT_BCR 56 #define GCC_QUSB2PHY_USB20_HS_BCR 57 #define GCC_SDCC2_BCR 58 #define GCC_SDCC4_BCR 59 #define GCC_UFS_PHY_BCR 60 #define GCC_USB20_PRIM_BCR 61 #define GCC_USB30_MP_BCR 62 #define GCC_USB30_PRIM_BCR 63 #define GCC_USB30_SEC_BCR 64 #define GCC_USB30_TERT_BCR 65 #define GCC_USB3_MP_SS0_PHY_BCR 66 #define GCC_USB3_MP_SS1_PHY_BCR 67 #define GCC_USB3_PHY_PRIM_BCR 68 #define GCC_USB3_PHY_SEC_BCR 69 #define GCC_USB3_PHY_TERT_BCR 70 #define GCC_USB3_UNIPHY_MP0_BCR 71 #define GCC_USB3_UNIPHY_MP1_BCR 72 #define GCC_USB3PHY_PHY_PRIM_BCR 73 #define GCC_USB3PHY_PHY_SEC_BCR 74 #define GCC_USB3PHY_PHY_TERT_BCR 75 #define GCC_USB3UNIPHY_PHY_MP0_BCR 76 #define GCC_USB3UNIPHY_PHY_MP1_BCR 77 #define GCC_USB4_0_BCR 78 #define GCC_USB4_0_DP0_PHY_PRIM_BCR 79 #define GCC_USB4_1_DP0_PHY_SEC_BCR 80 #define GCC_USB4_2_DP0_PHY_TERT_BCR 81 #define GCC_USB4_1_BCR 82 #define GCC_USB4_2_BCR 83 #define GCC_USB_0_PHY_BCR 84 #define GCC_USB_1_PHY_BCR 85 #define GCC_USB_2_PHY_BCR 86 #define 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