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/* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */ /* * Copyright (c) Qualcomm Technologies, Inc. and/or its subsidiaries. */ #ifndef _DT_BINDINGS_CLK_QCOM_GCC_GLYMUR_H #define _DT_BINDINGS_CLK_QCOM_GCC_GLYMUR_H /* GCC clocks */ #define GCC_GPLL0 0 #define GCC_GPLL0_OUT_EVEN 1 #define GCC_GPLL1 2 #define GCC_GPLL14 3 #define GCC_GPLL14_OUT_EVEN 4 #define GCC_GPLL4 5 #define GCC_GPLL5 6 #define GCC_GPLL7 7 #define GCC_GPLL8 8 #define GCC_GPLL9 9 #define GCC_AGGRE_NOC_PCIE_3A_WEST_SF_AXI_CLK 10 #define GCC_AGGRE_NOC_PCIE_3B_WEST_SF_AXI_CLK 11 #define GCC_AGGRE_NOC_PCIE_4_WEST_SF_AXI_CLK 12 #define GCC_AGGRE_NOC_PCIE_5_EAST_SF_AXI_CLK 13 #define GCC_AGGRE_NOC_PCIE_6_WEST_SF_AXI_CLK 14 #define GCC_AGGRE_UFS_PHY_AXI_CLK 15 #define GCC_AGGRE_UFS_PHY_AXI_HW_CTL_CLK 16 #define GCC_AGGRE_USB2_PRIM_AXI_CLK 17 #define GCC_AGGRE_USB3_MP_AXI_CLK 18 #define GCC_AGGRE_USB3_PRIM_AXI_CLK 19 #define GCC_AGGRE_USB3_SEC_AXI_CLK 20 #define GCC_AGGRE_USB3_TERT_AXI_CLK 21 #define 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